stm32: rcc: convert to use new standard defines
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@@ -25,9 +25,9 @@ const struct rcc_clock_scale rcc_3v3[RCC_CLOCK_3V3_END] = {
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.plln = 432,
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.pllp = 2,
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.pllq = 9,
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.hpre = RCC_CFGR_HPRE_DIV_NONE,
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.ppre1 = RCC_CFGR_PPRE_DIV_4,
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.ppre2 = RCC_CFGR_PPRE_DIV_2,
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.hpre = RCC_CFGR_HPRE_NODIV,
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.ppre1 = RCC_CFGR_PPRE_DIV4,
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.ppre2 = RCC_CFGR_PPRE_DIV2,
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.vos_scale = PWR_SCALE1,
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.overdrive = 1,
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.flash_waitstates = 7,
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@@ -39,9 +39,9 @@ const struct rcc_clock_scale rcc_3v3[RCC_CLOCK_3V3_END] = {
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.plln = 336,
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.pllp = 2,
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.pllq = 7,
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.hpre = RCC_CFGR_HPRE_DIV_NONE,
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.ppre1 = RCC_CFGR_PPRE_DIV_4,
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||||
.ppre2 = RCC_CFGR_PPRE_DIV_2,
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.hpre = RCC_CFGR_HPRE_NODIV,
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.ppre1 = RCC_CFGR_PPRE_DIV4,
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.ppre2 = RCC_CFGR_PPRE_DIV2,
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||||
.vos_scale = PWR_SCALE2,
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.overdrive = 1,
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.flash_waitstates = 5,
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@@ -53,9 +53,9 @@ const struct rcc_clock_scale rcc_3v3[RCC_CLOCK_3V3_END] = {
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.plln = 240,
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.pllp = 2,
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.pllq = 5,
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.hpre = RCC_CFGR_HPRE_DIV_NONE,
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.ppre1 = RCC_CFGR_PPRE_DIV_4,
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||||
.ppre2 = RCC_CFGR_PPRE_DIV_2,
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||||
.hpre = RCC_CFGR_HPRE_NODIV,
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||||
.ppre1 = RCC_CFGR_PPRE_DIV4,
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.ppre2 = RCC_CFGR_PPRE_DIV2,
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.vos_scale = PWR_SCALE3,
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.overdrive = 0,
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.flash_waitstates = 3,
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@@ -67,9 +67,9 @@ const struct rcc_clock_scale rcc_3v3[RCC_CLOCK_3V3_END] = {
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.plln = 144,
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.pllp = 2,
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.pllq = 3,
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.hpre = RCC_CFGR_HPRE_DIV_NONE,
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.ppre1 = RCC_CFGR_PPRE_DIV_4,
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||||
.ppre2 = RCC_CFGR_PPRE_DIV_2,
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||||
.hpre = RCC_CFGR_HPRE_NODIV,
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||||
.ppre1 = RCC_CFGR_PPRE_DIV4,
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.ppre2 = RCC_CFGR_PPRE_DIV2,
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||||
.vos_scale = PWR_SCALE3,
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||||
.overdrive = 0,
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.flash_waitstates = 2,
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@@ -81,9 +81,9 @@ const struct rcc_clock_scale rcc_3v3[RCC_CLOCK_3V3_END] = {
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.plln = 192,
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.pllp = 4,
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.pllq = 4,
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.hpre = RCC_CFGR_HPRE_DIV_NONE,
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.ppre1 = RCC_CFGR_PPRE_DIV_2,
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.ppre2 = RCC_CFGR_PPRE_DIV_2,
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.hpre = RCC_CFGR_HPRE_NODIV,
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.ppre1 = RCC_CFGR_PPRE_DIV2,
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.ppre2 = RCC_CFGR_PPRE_DIV2,
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.vos_scale = PWR_SCALE3,
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.overdrive = 0,
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.flash_waitstates = 1,
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@@ -95,9 +95,9 @@ const struct rcc_clock_scale rcc_3v3[RCC_CLOCK_3V3_END] = {
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.plln = 192,
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.pllp = 8,
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.pllq = 4,
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.hpre = RCC_CFGR_HPRE_DIV_NONE,
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.ppre1 = RCC_CFGR_PPRE_DIV_NONE,
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.ppre2 = RCC_CFGR_PPRE_DIV_NONE,
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.hpre = RCC_CFGR_HPRE_NODIV,
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.ppre1 = RCC_CFGR_PPRE_NODIV,
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.ppre2 = RCC_CFGR_PPRE_NODIV,
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.vos_scale = PWR_SCALE3,
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.overdrive = 0,
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.flash_waitstates = 0,
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